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個人怎么做網(wǎng)站推廣競價推廣是什么意思

news 2025/7/14 3:00:08

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首先想一想再前幾篇文章講的協(xié)議類的前提

1、雙方約定好通信的協(xié)議
2、雙方滿足一定的時序要求
以上第二點(diǎn)又有一些要求：

1）弄清2440在這個通信協(xié)議中，能設(shè)置哪些時序的值，這些值的含義是什么——2440手冊
2）弄清楚這塊LCD的時序有什么要求，要取什么值——看LCD手冊
3）計算，這些值一般是以多少秒為一個時鐘等。
4）再將這些值寫入2440相應(yīng)的寄存器
本篇假定2440連接LCD

LCD傳輸?shù)氖鞘裁礀|西

HSYNC——水平方向的同步信號
VSYNC——垂直方向的同步信號
Data Enable——數(shù)據(jù)使能
CLK——時鐘
VD(R、G、B)——video data紅綠藍(lán)

作用：

HSYNC 信號用于告訴電子槍該掃描下一行了, 即要轉(zhuǎn)到下一行起始處了；
VSYNC 信號告訴電子槍該顯示下一幀了, 即該轉(zhuǎn)回左上角起始處了；
VD顏色信息
Data Enable是否讀取顏色數(shù)據(jù)并打印，高電平有效，低電平只移動
原理圖

引腳

1、VGH——電源供電（高電平）
2、DISP——控制開關(guān)
6、VGL——電源供電（低電平）
等等，有很多引腳

引腳含義

LCD的引線有非常多，那么怎么去理解這些引線呢？

將LCD屏理解為一個一個像素，每行有很多個點(diǎn)。
假想LCD后面有一個電子槍，將RGB顏色打到電子屏當(dāng)中。打完再一個又一個移動。
那么我們怎么知道這個電子槍移動到下一個位置呢——時鐘VCLK（video clock）

這是2440發(fā)出來的時鐘

這個時鐘一定需要滿足一定需求
太快——LCD反應(yīng)不過來
太慢——一個個像素慢慢出現(xiàn)，人眼受不了

那么一行結(jié)束，這個槍怎么跳到下一行呢——HSYNC/VLINE（水平方向同步信號）

一次刷新玩屏幕，這把槍在屏幕的最右下方的位置。下一次刷新需要把槍拿到第一個位置，這時怎么做——VSYNC/VFRAME（垂直方向同步信號）

顏色從哪里來——VD0~VD23（video data）

電子槍是否取出并打印數(shù)據(jù)，還是只移動不取數(shù)據(jù)——DE（data enable）

高電平則取數(shù)據(jù)打出來并移動
低電平只移動不取數(shù)據(jù)

流程如下

1、每來一個時鐘，從VD0~VD23取出一個顏色打到屏幕中
2、移動到一行最右邊的時候，2440發(fā)送一個HSYNC水平信號。這把槍從最右邊跳到下一行的最左邊。
3、到一頁的最后一個節(jié)點(diǎn)，2440發(fā)送一個VSYNC垂直信號。告訴這把槍要進(jìn)行下一幀了，將這把槍移動到起始位置。
原理圖導(dǎo)讀

這四個引腳是觸摸屏相關(guān)，先不用管

LED+和LED-

原理圖中電路如下

中間的芯片是一個電源芯片

↑這個引腳是接到2440的，2440把它配置成輸出引腳

若它輸出高電平，如何知道高電平是否有效？
電路圖中有一些約定俗成的習(xí)慣

EN——高電平有效
nEN、EN上加一橫線、EN/——低電平有效
什么都不寫——高電平有效

這個引腳輸出低電平，屏幕就變暗
輸出高電平，屏幕變亮
輸入電壓是5V，經(jīng)過這個芯片過后，會出來一個很高的電壓。這個電壓有20多V

接線

相同名字的線接到一起就行了。

同步信號時序圖

這些信號的時序都有要求，那么如何配置這些信號呢
這就需要配置LCD控制器

內(nèi)存相關(guān)
視頻數(shù)據(jù)從哪里來？
這就還需要配置顯存
在內(nèi)存SDRAM中分配一段地址作為顯存，然后把這段地址告訴LCD控制器
在設(shè)置好LCD控制器的各項(xiàng)參數(shù)后,它就會從地址對應(yīng)的顯存中去讀取數(shù)據(jù)

相關(guān)過程:

1、LCD控制器讀取顯存中第一個點(diǎn)的數(shù)據(jù)，讀出來發(fā)送到VD0~VD23中對應(yīng)的數(shù)據(jù)線上面，結(jié)合已經(jīng)配置好的信號發(fā)送給LCD。
2、LCD從video data數(shù)據(jù)線上得到像素信息后，打印出來。然后依次反復(fù)打印下一個。
3、根據(jù)HSYNC、VSYNC信號進(jìn)行換行和回到起始位置進(jìn)行下一幀。換到下一幀時，LCD控制器又會從顯存的第一個地址開始讀取。

LCD控制器

所有信號都是由LCD控制器發(fā)出來的
2440發(fā)出信號的時序需要根據(jù)連接的LCD屏幕進(jìn)行配置

如VCLK的頻率
LCD的規(guī)格，是320*240的，還是多少。這關(guān)乎于HSYNC水平信號要發(fā)多少個，然后再發(fā)VSYNC豎直信號。

接下來開始看2440的芯片手冊

先打開對應(yīng)的LCD控制器章節(jié)

jz2440中LCD的時序

可以找到如下一張LCD時序的例子

這是2440的圖。
接下來我們看能設(shè)置哪些參數(shù)

以水平方向信號為例。

這個水平方向，是一個高脈沖。這個脈沖要維持多長時間，我們就可以通過設(shè)置HSPW+1

收到HSYNC后，電子槍從最右邊跳到下一行的最左邊。不可能是一瞬間就過去的。LCD收到信號后，要過一段時間才能輸出第一個像素。這個時間可以設(shè)置HBPD+1

接下來就是VD（video data）輸出一行的數(shù)據(jù)。一行數(shù)據(jù)有多少個像素。一行的像素個數(shù)需要根據(jù)LCD規(guī)格來設(shè)置：如一行是320，那么就設(shè)置成319個數(shù)據(jù)?？梢栽O(shè)置HOZVAL+1

發(fā)完一行數(shù)據(jù)后，要再等一段時間才能發(fā)出下一個水平方向的信號。這段時間就可以設(shè)置HFPD+1

注意：以上四個數(shù)據(jù)，計算得出正確的值要減一，再配置到相應(yīng)的寄存器當(dāng)中。

VCLK